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5-stage-pipeline-cpu

实现了5段流水的CPU This project is verilog that implements 5-stage-pipeline-cpu

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单周期 8指令 MIPS32CPU

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深度学习经典论文翻译

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此项目为本人2022年报考合肥工业大学计算机科学与技术学硕上岸经验分享，包含初试、复试经验与资料分享，内容编排上更偏common，一方面作为留存，一方面给需要的同学参考。未完待续。部分信息已委托（授权）合工大求臻学长学姐在相关公众平台发布。

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合肥工业大学计算机科学与技术/Computer Science and Technology, Hefei University of Technology

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合肥工业大学宣城校区（HFUT-XC） 计算机科学与技术专业（CS）。本仓库存有大一至大三的专业课程， 学长还没有毕业，有需求可以提Issue。欢迎Star，会不定时更新

hfut-cs-assignments

合肥工业大学 计算机科学与技术专业 专业课作业和实验（大二下 - 大三下）

hfut-ycj

hfut_2020_mips_cpu

合肥工业大学2020年《系统硬件综合设计》（《计算机组成原理》课程设计，CPU）的代码与报告；使用Verilog实现全冒险处理机制的MIPS五段流水CPU，支持MIPS-C3的50条指令。

hfut_2020_os_design_wh

合肥工业大学宣城校区2020年《操作系统》课程设计。题目：段页式虚拟存储管理系统：建立一个段页虚拟存储管理系统的模型。Course Design of Operating System in Xuancheng Campus of Hefei University of Technology in 2020. Topic: Segment Page Virtual Storage Management System: To establish a model of segment page virtual storage management system.

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贵校课程资料民间整理

mingpt

A minimal PyTorch re-implementation of the OpenAI GPT (Generative Pretrained Transformer) training

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一些论文的复现代码

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经典论文翻译

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编程之路

step_into_mips

一步一步写MIPS CPU

tcpchat-of-qt

hfut network course design