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brenoamin / plataforma-jogos-laboratorio-iv Goto Github PK

Este repositório contém a solução para o problema do Laboratório Integrado, que consiste na criação de uma Plataforma de Jogos em FPGA baseada em módulos distintos. A nota final na disciplina é calculada com base nas notas obtidas em cada um dos problemas (ou módulos) propostos.

Verilog 37.28% HTML 0.01% Stata 0.08% Standard ML 0.01% Scheme 0.02% Dockerfile 0.01% Tcl 0.40% SystemVerilog 23.58% C 28.13% C++ 0.01% Makefile 5.82% Shell 0.22% Assembly 3.86% GDB 0.10% VHDL 0.49%

plataforma-jogos-laboratorio-iv's Introduction

plataforma-jogos-laboratorio-iv

Módulo 1	Módulo 2	Módulo 3
Background	Sprites	Processador

plataforma-jogos-laboratorio-iv's People

Contributors

Stargazers

Watchers

Forkers

taffarel55 isaacpcaraujo rf-vinicius elbervitor leandro-gama

plataforma-jogos-laboratorio-iv's Issues

Criar memória de programa

Criar uma memória 32x32k para armazenar instruções
Criar testbench

Entradas:

ADDR

Saídas:

DATA

Criar contador de programa

Criar registrador de 32 bits com set sincrono com ativação positiva.
Criar um circuito combinacional para selecionar a entrada do registrador
Criar testbench

Entradas:

JR_Control
R_abs
clk
rst

Saídas:

Q (pointer address)

Alinhar arquitetura com todo o time

@brenoamin @GeraldinJr @isaacpcaraujo @ofabiobraga @henriqsp, leo

E ai pessoal, ainda temos bastante coisa para fazer. Vamos tentar pegar as tarefas e tocar!

Criar o extensor para 32bits

Módulo deve ser parametrizável e deve complentar valores em complemento de 2 para um tamanho de 32 bits

Entradas:

INSTR

Saída:

Ext_immediate

Criar registradores de pipeline

Criar registradores que ficam nos estágios intermediários

Entradas:

Diversas

Saídas:

Diversas

Entender como vai funcionar o processo de integração entre o Processador-Background
Entender como vai funcionar o processo de integração entre o Processador-Sprites
Quais estágios serão os responsáveis por garantir essa conexão? Quem vai usar o que?

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